首頁　 資訊　 商機 　 下載　 拆解 　 高校　 招聘 　 雜志　 會展　 EETV　 百科 　 問答　 電路圖　 工程師手冊 　 Datasheet　 100例 　 活動中心　 E周刊閱讀 　 樣片申請
EEPW首頁 >> 主題列表 >> cadence

cadence 文章 進入cadence技術社區

Cadence 加強其 Tensilica Vision 和 AI 軟件合作伙伴生態

  • 新加入的生態系統成員包括 Kudan 和 Visionary.ai，有助于快速部署高性能、高能效的基于 SLAM 和 AI ISP 的解決方案 中國上海，2023 年 4 月 12 日 —— 楷登電子（美國 Cadence 公司，NASDAQ：CDNS）今日宣布歡迎 Kudan 和 Visionary.ai 加入 Tensilica 軟件合作伙伴生態系統，他們將為 Cadence? Tensilica? Vision DSP 和 AI 平臺帶來業界領先的同步與地圖構建 （SLAM）和 AI 圖像
  • 關鍵字： Cadence  Tensilica Vision  AI 軟件  

Cadence 推出 Allegro X AI，旨在加速 PCB 設計流程，可將周轉時間縮短 10 倍以上

  • 中國上海，2023 年 4 月 7 日 —— 楷登電子（美國 Cadence 公司，NASDAQ：CDNS）今日宣布推出 Cadence? Allegro? X AI technology，這是 Cadence 新一代系統設計技術，在性能和自動化方面實現了革命性的提升。這款 AI 新產品依托于 Allegro X Design Platform 平臺，可顯著節省 PCB 設計時間，與手動設計電路板相比，在不犧牲甚至有可能提高質量的前提下，將布局布線（P&R）任務用時從數天縮短至幾分鐘。?
  • 關鍵字： Cadence  Allegro  PCB  

電路老化不均勻成為 IC 設計師面對的大問題

  • 半導體行業在了解 IC 老化如何影響可靠性方面正在取得進展，但仍有問題待解決。
  • 關鍵字： Cadence  仿真  

Cadence榮獲六項2022 TSMC OIP年度合作伙伴大獎

  • 內容提要：·?????? Cadence 憑借關鍵的 EDA、云和 IP 創新榮獲 TSMC 大獎；·?????? Cadence 是 TSMC 3DFabric 聯盟的創始成員之一。?中國上海，2022年12月14日——楷登電子（美國 Cadence 公司，NASDAQ：CDNS）今日宣布，其 EDA、IP 和云計算解決方案獲得了 TSMC 頒發的六項 Open Innova
  • 關鍵字： Cadence  2022 TSMC OIP  

聯電與Cadence共同開發認證的毫米波參考流程達成一次完成硅晶設計

  • 聯華電子與全球電子設計創新領導廠商益華計算機(Cadence Design Systems, Inc.)于今(30)日宣布雙方合作經認證的毫米波參考流程，成功協助亞洲射頻IP設計的領導廠商聚睿電子(Gear Radio Electronics)，在聯電28HPC+ 制程技術以及Cadence? 射頻(RF)解決方案的架構下，達成低噪音放大器 (LNA) IC一次完成硅晶設計(first-pass silicon success) 的非凡成果。 經驗證的聯電28HPC+解決方案非常適合生產應用于高
  • 關鍵字： 聯電  Cadence  毫米波參考流程  

Cadence Certus新品亮相!助力全芯片并行優化和簽核速度提高10倍

  • 內容提要：●? ?為客戶提供業內首個具有大規模并行和分布式架構的完全自動化環境；●? ?支持無限容量的設計優化和簽核，周轉時間縮短至一夜，同時大幅降低設計功耗；●? ?支持云的解決方案，推動新興設計領域的發展，包括超大規模計算、5G 通信、移動、汽車和網絡?？请娮樱绹?Cadence 公司）近日宣布推出新的 Cadence??Certus??Closure Solution，以應對不斷增長的芯片級設計尺寸和復雜性挑戰。Ca
  • 關鍵字： Cadence  并行優化  簽核速度  

Cadence發布Verisium AI-Driven Verification Platform引領驗證效率革命

  • 楷登電子（美國 Cadence 公司）近日宣布，推出 Cadence? Verisium? Artificial Intelligence (AI)-Driven Verification Platform，整套應用通過大數據和 JedAI Platform 來優化驗證負荷、提高覆蓋率并加速 bug 溯源。Verisium 平臺基于新的 Cadence Joint Enterprise Data AI (JedAI) Platform，并與 Cadence 驗證引擎原生集成。隨著 SoC 復雜性不斷提高，
  • 關鍵字： Cadence  Verisium AI-Driven Verification Platform  驗證  

聯電與Cadence攜手22納米模擬與混合信號設計認證

  • 聯華電子與Cadence于今(8月24)日共同宣布，Cadence的模擬與混合信號(Analog/Mixed Signal, AMS)芯片設計流程獲得聯華電子22納米超低功耗 (22ULP)與22納米超低漏電(22ULL)制程認證，此流程可優化制程效率、縮短設計時間，加速5G、物聯網和顯示等應用設計開發，滿足日漸增高的市場需求。 聯電的22納米制程具有超低功耗和超低漏電的技術優勢，可滿足在科技創新發展下，使用時間長、體積小、運算強的應用需求。經聯電認證的Cadence AMS設計流程，提供了整合
  • 關鍵字： 聯電  Cadence  22納米  模擬與混合信號  

Cadence 通過面向 TSMC 先進工藝的 PCIe 5.0 PHY 和控制器 IP 規范合規性認證

  • 楷登電子（美國 Cadence 公司）今日宣布，其面向 TSMC N7、N6 和 N5 工藝技術 PCI Express?（PCIe?）5.0 規范的 PHY 和控制器 IP 在 4 月舉行的業界首次 PCIe 5.0 規范合規認證活動中通過了 PCI-SIG? 的認證測試。Cadence? 解決方案經過充分測試，符合 PCIe 5.0 技術的 32GT/s 全速要求。該合規計劃為設計者提供測試程序，用以評估系統級芯片（SoC）設計的 PCIe 5.0 接口是否會按預期運行。 面向 PCIe 5
  • 關鍵字： Cadence  TSMC  PCIe 5.0  

聯發科與瑞薩采用Cadence Cerebrus AI方案 優化芯片PPA

  • Cadence Design Systems, Inc.宣布，Cadence Cerebrus?智能芯片設計工具(Intelligent Chip Explorer) 獲得客戶采用于其全新量產計劃。此基于 Cadence Cerebrus 采用人工智能 (AI) 技術帶來自動化和擴展數字芯片設計能力，能為客戶優化功耗、效能和面積 (PPA)，以及提高工程生產力。Cadence Cerebrus 運用革命性的AI技術，擁有獨特的強化學習引擎，可自動優化軟件工具和芯片設計選項，提供更好的 PPA進而大幅減少工
  • 關鍵字： 聯發科  瑞薩  Cadence  Cerebrus AI  芯片PPA  

適用于電池供電設備的熱感知高功率高壓板

  • 電池供電馬達控制方案為設計人員帶來多項挑戰，例如，優化印刷電路板熱效能至今仍十分棘手且耗時；但現在，應用設計人員可利用現代化電熱仿真器輕松縮短上市時間。如今，電池供電馬達驅動解決方案通?？捎脴O低的工作電壓提供數百瓦的功率。在此類應用中，為確保整個系統的效能和可靠性，必須正確管理馬達驅動設備的電流。事實上，馬達電流可能會超過數十安培，導致變流器內部耗散功率提升。為變流器組件施加較高的功率將會導致運作溫度升高，效能下降，如果超過最額定功率，甚至會突然停止運作。優化熱效能同時縮小大小，是變流器設計過程中的重要一
  • 關鍵字： 電池供電  熱感知  高功率高壓板  ST  Cadence  

當人工智能遇到EDA，Cadence Cerebrus以機器學習提升EDA設計效能

  • 隨著算力的不斷提升，人工智能的應用逐漸滲透到各個行業。作為人工智能芯片最關鍵的開發工具EDA，是否也會得到人工智能應用的助力從而更好地提升服務效率呢？答案自然是肯定的。隨著半導體芯片設計的復雜度不斷提升，以及芯片包含功能的日漸廣泛，EDA的設計過程越來越需要借助人工智能來盡可能避免一些常見的設計誤區，并借助大數據的優勢來實現局部電路設計的最優化。在可以預見的未來，隨著人工智能技術的不斷引入，借助大數據和機器學習的優勢，EDA軟件將可以提供更高效更強大的設計輔助功能。 近日，楷登電子（Cadenc
  • 關鍵字： 人工智能  EDA  Cadence  Cerebrus  

大幅縮減設計進程 Cadence新設備為硬件仿真驗證提速

  • 當前隨著國內IC設計產業越來越受關注，短時間內涌現出海量的IC設計初創企業，對這些初創或者正在快速成長的IC設計企業來說，如何盡可能縮短設計進程，加速設計上市時間是一個不可回避的關鍵點。作為當下幾乎已經占據IC設計近60%工作量的仿真與驗證環節，如果能夠借助先進的工具大幅縮短這個過程所需的時間，那么將為諸多IC設計企業的產品成功增添重要的砝碼。 為了更好地提升IC設計客戶的仿真與驗證效率，三大EDA公司不斷更新各自的仿真驗證工具，希望盡可能將該環節的時間大幅壓縮，其中Cadence選擇推出下一代
  • 關鍵字： Cadence  Palladium Z2  Protium X2  仿真驗證  

Cadence推出新一代電路仿真器FastSPICE 效能高達3倍

  • Cadence 宣布全新的Cadence Spectre FX 仿真器(Simulator)，此新一代的FastSPICE電路仿真器能夠有效驗證內存和大規模系統單芯片(SoC)設計。Spectre FX 仿真器中具創新和可擴展性的FastSPICE架構，可為客戶提供高達3倍的效能。當今復雜的內存和SoC設計需要高精度和快速模擬效能，以確保按預期運作并滿足芯片規格。 此外，在芯片驗證過程中，布局后寄生效應變得越來越重要，尤其是對于先進制程設計而言，要考慮布局對芯片功能的影響。 FastSPICE求解器可在S
  • 關鍵字： Cadence  電路仿真器  FastSPICE  

靜電槍電路模型的建立及驗證

  • ESD一直是電氣和電子元件產品的主要關注點和突出威脅。在系統級ESD測試過程中，通常用靜電槍來模擬ESD放電場景，放電電流波形必須符合IEC 61000-4-2標準。但標準給的誤差范圍較大，較大的誤差會影響仿真結果的準確性。本文在Cadence下建立了靜電槍電路模型，包括接觸放電模型和HBM模型，具有較高的精確性。模型產生的電流波形與實際測試電流波形吻合性較好，驗證了模型的準確性。該電路模型為靜電放電仿真提供了一個新的激勵源。
  • 關鍵字： 202008  ?靜電放電  Cadence  電路模型  靜電槍  
共334條 1/23 1 2 3 4 5 6 7 8 9 10 » ›|

cadence介紹

EDA仿真軟件Cadence -------------------------------------------------------------------------------- Cadence Design Systems Inc.是全球最大的電子設計技術(Electronic Design Technologies)、程序方案服務和設計服務供應商。其解決方案旨在提升和監控半導 [ 查看詳細 ]

cadence相關帖子

更多

cadence資料下載

更多

cadence視頻

更多

cadence專欄文章

更多

相關主題

Cadence　 Cadence?Virtuoso?　 Cadence.SPB.15.2.　

熱門主題

Cadence?Virtuoso?    Cadence.SPB.15.2.    樹莓派    linux   
關于我們 - 廣告服務 - 企業會員服務 - 網站地圖 - 聯系我們 - 征稿 - 友情鏈接 - 手機EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產品世界》雜志社 版權所有 北京東曉國際技術信息咨詢有限公司
備案 京ICP備12027778號-2 北京市公安局備案：1101082052    京公網安備11010802012473
免费一级在线观看a片视频