- 數字下變頻是一種數字信號處理技術，廣泛用于數字無線電接收機。本文將回顧數字下變頻器 (DDC) 的基礎知識。我們將首先了解使用 DDC 而不是模擬對應物的優勢。然后，我們將討論一個示例并探索 DDC 的基本操作。本文討論數字下變頻，這是一種廣泛用于數字無線電接收器的數字信號處理技術。數字下變頻是一種數字信號處理技術，廣泛用于數字無線電接收機。本文將回顧數字下變頻器 (DDC) 的基礎知識。我們將首先了解使用 DDC 而不是模擬對應物的優勢。然后，我們將討論一個示例并探索 DDC 的基本操作。要了
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DSP
- 為了滿足捷聯導航計算機高精度、低成本、低功耗和小型化的要求，本文針對捷聯導航計算機進行研究。首先介紹慣性導航的基本概念，引出捷聯慣性導航計算機這一概念。然后簡單分析了導航計算機的基本工作任務。再從硬件架構上分類列舉了五類不同的硬件實現方式，并分析它們的優勢和不足。最后對未來捷聯導航計算機的發展進行了進一步展望。
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202302 捷聯慣性導航 導航計算機 DSP FPGA
- 《征求意見稿》提出重點支持高端通用芯片、專用芯片和核心芯片、化合物半導體芯片等芯片設計；硅基集成電路制造；氮化鎵、碳化硅等化合物半導體制造，從多個層面全面培育發展深圳半導體與集成電路產業集團的發展，深入資金、平臺、政策、人才、產業園區等多方面的支持。國際電子商情10日訊 深圳市發展和改革委員會日前發布了《深圳市關于促進半導體與集成電路產業高質量發展的若干措施（征求意見稿）》（下稱《若干措施》）?！度舾纱胧诽岢鲋攸c支持高端通用芯片、專用芯片和核心芯片、化合物半導體芯片等芯片設計；硅基集成電路制造；氮化鎵、
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CPU GPU DSP FPGA IC設計
- 可重構計算解決方案、架構和軟件的領先供應商Flex Logixò Technologies, Inc.與全球領先的無線連接和智能傳感技術及集成IP解決方案的授權許可廠商CEVA, Inc.宣布成功推出世界上第一個集成CEVA-X2 DSP指令擴展接口的 Flex Logix EFLX? 嵌入式FPGA (eFPGA)芯片產品。這款ASIC器件稱為 SOC2，支持靈活和可更改的指令集，以滿足要求嚴苛且不斷變化的處理工作負載。該產品由 Bar-Ilan大學 SoC 實驗室設計，并采用 臺積電16
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CEVA FPGA DSP
- 主要研究使用EtherCAT總線在線更新TI C2000系列DSP應用軟件的方法。移植EtherCAT總線從站到C2000系列DSP上，針對C2000系列DSP設計編寫了相應的BootLoader程序，開發了簡單的應用程序。試驗研究表明：使用此方法可以在線快速通過EtherCAT總線更新C2000系列DSP的應用程序，此方法有效。
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EtherCAT 在線更新 DSP 202009
- BiSS協議是一種高速同步串行通信協議，使用BiSS協議的編碼器有利于提高伺服控制系統的動態性能，在高精度絕對式編碼器中應用廣泛。本文在分析BiSS協議數據幀特點的基礎上，利用FPGA設計了BiSS協議編碼器解碼器，采集了BiSS協議編碼器位置數據和總線波形，通過與DSP聯合使用，基于BiSS協議編碼器對永磁同步電機的動態性能進行了驗證，結果表明該設計的合理性。
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BiSS FPGA 編碼器 DSP 202108
- AD7403是一種Σ-Δ型模數轉換器，廣泛應用于需要電氣隔離的伺服控制電機相電流采集場合。EG4A20BG256是一種國產FPGA，適用于伺服控制系統信號采集﹑接口擴展等應用場景。本文基于EG4A20BG256 FPGA設計了AD7403模數轉換器接口電路，采集永磁同步電機相電流，并與伺服控制電路內霍爾電流傳感器和DSP采樣結果進行了對比。結果表明，EG4A20BG256 FPGA可以通過AD7403模數轉換器實現對永磁同步電機相電流的準確采集。
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AD7403 EG4A20BG256 FPGA DSP 永磁同步電機 202105
- 摘要：針對目前BiSS協議編碼器數據讀取多采用FPGA實現的實際情況，文中介紹一種基于XMC4500微控制器的BiSS協議編碼器數據讀取實現方案。采用該方案，可將使用BiSS協議編碼器的伺服系統控制電路常用的DSP+FPGA雙控制器架構方式簡化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開發難度。用該方案采集BiSS協議編碼器數據的實物平臺，使用LabVIEW顯示對讀取的數據，并與電機自帶增量編碼器值進行對比，同時記錄BiSS協議編碼器實際數據波形圖，結果表明，該方案具有較高的采樣速率和較好
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202106 BiSS XMC4500 DSP FPGA LabVIEW
- 隨著通信技術的快速發展，5G已經正式商用，5G的6G以下波段對傳輸有很高的要求，在6G以上的毫米波段要求的信號帶寬更大，數據傳輸速率更高，高速大帶寬信號要求基帶信號處理的速度將大大增加，對極高速數據流的實時處理和解析使測試變得更加困難，本文主要是研究與設計毫米波基帶數據的傳輸與實現：前端DA的研究與設計、傳輸鏈路的FPGA實現以及毫米波數據的DSP接收處理過程，最后把實現流程成功應用到5G測試儀表之中，驗證了設計的正確性。
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202104 毫米波 FPGA 基帶數據 DSP
- 在實時處理系統中，DSP與主控模塊的通信能力已經成為系統處理的瓶頸。千兆以太網具有速率高、成本低和穩定性好的優點，可滿足DSP與主控模塊數據傳輸的需要。以TI公司的TMS320TCI6487 DSP芯片和Marvell公司的88E1111物理層芯片為例，對硬件電路、千兆以太網的網口驅動程序、基于SYS/BIOS和NDK的TCP協議進行研究，在TMS320TCI6487實現了TCP通信。實驗結果顯示，基于DSP的千兆以太網傳輸速率可達到960 Mbps。
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DSP 千兆以太網 SYS/BIOS NDK TCP
- 2020年9月8日中國深圳 高性能、低功耗串行連接解決方案領域全球創新領導者Credo今日宣布：推出新一代Dove系列低功耗PAM4 高速光通信數字信號處理器（DSP）。此次發布的Dove系列包括四款新品： Dove 100、Dove 150、Dove 200及Dove 400光通信DSP，專為下一代100G / 200G / 400G數據中心網絡平臺打造?！ redo獨特的PAM4 DSP架構可最大程度減小芯片尺寸，產品使用主流工藝制成，可為下一代光模塊提供最佳的性能、成本與功耗： 使
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Dove系列 DSP 數據中心網絡
- 高性能、低功耗串行連接解決方案領域全球創新領導者 Credo 近日宣布：推出新一代 Dove 系列低功耗 PAM4 高速光通信數字信號處理器（DSP）。此次發布的Dove系列包括四款新品： Dove 100、Dove 150、Dove 200及Dove 400光通信DSP，專為下一代100G / 200G / 400G數據中心網絡平臺打造。Credo獨特的PAM4 DSP架構可最大程度減小芯片尺寸，產品使用主流工藝制成，可為下一代光模塊提供最佳的性能、成本與功耗： 使用Credo Dove 系列PAM4
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DSP CIOE
- Credo——高性能、低功耗串行連接解決方案領域全球創新領導者——近日宣布推出Seagull 50芯片，一款專供于5G無線通信網絡中前傳/中傳光模塊的高性能光通信數字信號處理器（DSP）。Credo Seagull 50滿足了移動網絡不斷攀升的帶寬需求，支持長距離傳輸及工業級工作溫度范圍。Credo Seagull 50 可配置為兩種工作模式：2x25G <—>1x50G 及 1x50G <—> 1x50G。Seagull 50產品采用Credo獨特設計架構，最大程度減小芯片尺寸，
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RAN CIOE 2020 DSP
- 對于那些手機使用了驍龍處理器的用戶來說，高通已經證實了之前曝光的漏洞，而且非常的可怕。高通公司已經證實在他們的智能手機芯片組中發現了一個巨大的缺陷，使手機完全暴露在黑客面前。該漏洞由Check Point安全公司發現，大量Android手機中的Snapdragon DSP的缺陷會讓黑客竊取數據，安裝難以被發現的隱藏間諜軟件，甚至可以徹底將手機損壞而無法使用。Check Point在Pwn2Own上公開披露了這一缺陷，揭示了內置高通驍龍處理器手機中的DSP的安全性設定被輕易繞過，并在代碼中發現了400處可利
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高通 驍龍 DSP 安卓
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